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通信算法工程师社会招聘2025年07月02日
岗位职责
1、精通无线通信理论;
2、制定通信系统的设计指标,搭建仿真环境,确定系统和模块的算法设计方案;
3、指导数字 IC 设计工程师完成相关模块设计,指导 FPGA 原型验证;
4、分析通信芯片的各项测试数据,进而优化系统。
任职要求
1、数字信号处理/通信工程等相关专业,硕士及以上学历;
2、3 年以上相关工作经验;
3、精通无线通讯理论与算法,有 Wi-Fi/BT/GNSS 等无线系统设计的相关经验者优先;
4、精通 Matlab,对 Verilog 设计有一定概念;
5、对通信算法有浓厚的兴趣和强烈的求知欲。
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IC 设计工程师(基带设计)社会招聘2025年02月20日
岗位职责
1、设计并实现 Wi-Fi/BLE 等无线通信 IP 的数字基带模块;
2、优化逻辑,确保满足规格要求,包括功耗、面积、时序、可靠性等;
3、熟悉和理解数字验证流程,配合 DV 完成验证工作;
4、参与系统级联调,分析数据,提升系统性能。
任职要求
1、硕士及以上学历,微电子/电子工程/通信工程等相关专业;
2、具有扎实的数字电路理论基础,精通 verilog 语言;
3、熟练 ASIC 设计流程及 EDA 工具;
4、具有 Wi-Fi、BT、BLE 等无线通信 IP 的数字基带设计经验,熟悉基带调制、解调、同步等算法;
5、具有较强的自我学习和创新意识,对技术和产品有强烈的兴趣和热情。
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IC 设计工程师(SOC)社会招聘2025年02月20日
岗位职责
1、参与 SOC 模块 RTL 设计和 IP 集成;
2、参与芯片级系统设计,包括时钟/复位、低功耗、总线设计等;
3、配合验证/测试人员完成模块/系统级验证;
4、支持前端工程师,完成网表交付,包含解决时序问题;
5、支持驱动开发和问题解决,以及文档编写。
任职要求
1、硕士及以上学历,微电子/电子工程/通信工程等相关专业;
2、具有扎实的数字电路理论基础,精通 verilog 语言;
3、熟练 ASIC 设计流程及 EDA 工具;
4、精通 CPU、Cache 架构和指令体系,熟悉编译器原理;
5、精通总线、DMA、外设等设计;
6、精通低功耗设计。
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IC 设计工程师(MAC)社会招聘2025年02月20日
岗位职责
1、开发无线通讯系统 MAC 层以及子系统,包括 WIFI、BT/BLE 和 802.15.4 等协议;
2、根据功能需求完成文档的编写以及 RTL 的设计;
3、协助验证组和 FPGA 组完成设计的验证;
4、协助固件组调试软硬件问题,以及相关认证测试;
5、关注和了解协议的动态,并将其更新到设计中。
任职要求
1、硕士及以上学历,微电子、电子工程、通信工程等相关专业;
2、扎实的数字电路设计功底,熟练使用常用的数字电路设计工具;
3、熟练使用 Verilog 和 C 语言,熟练使用 Python、TCL、Perl 等常用脚本语言;
4、有无线通讯设计相关经验优先。
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模拟 IC 设计工程师(星光计划)星光计划2025年07月01日「星光本科人才计划」是乐鑫科技专为全球顶尖本科毕业生打造的招聘项目,长期开放且独立于乐鑫校园招聘,是一条通向技术前沿、快速成长的高速通道。岗位职责1、前沿设计:负责创新模拟电路的设计、仿真和验证,涵盖 LDO、Oscillator、IO、ESD、ADC、DAC、PLL、Filter 等高难度电路模块,从概念到实现,推动技术边界;2、高效 Floorplan:主导模拟 Layout 的 Floorplan设计,优化电路布局,提升性能和稳定性,解决复杂的版图挑战;3、技术指导:指导版图工程师进行设计,确保版图与电路设计的一致性和高质量实现;4、跨团队协作:与应用工程师、产品工程师和测试工程师紧密合作,解决技术难题,确保产品顺利从设计阶段过渡到量产;5、技术文档:撰写详细设计文档,记录设计过程和技术决策,推动团队知识共享和技术积累。任职要求1、顶尖高校本科生,微电子/电子信息/通信工程等相关专业;2、掌握模拟电路基础知识,能够将理论知识应用于实际设计中,挑战技术极限;3、具备一种或多种模拟电路设计经验,如 LDO、Oscillator、IO、ESD、ADC、DAC、PLL、Filter 等,具备实际的设计和优化能力;4、熟悉至少一种编程语言,如 Python、Matlab 或 C,能够进行自动化设计和数据分析;5、具备出色的独立问题解决能力和创新思维,能够在高压环境中快速适应并推动项目进展;6、优秀的沟通和学习能力,能够与跨职能团队协作,共同解决技术难题。campus@espressif.com
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IC 设计工程师(IP 设计方向)社会招聘2025年02月20日岗位职责1、负责 IP 核的设计和开发,包括但不限于安全类、接口类、多媒体类等;2、进行 IP 核的架构设计、功能定义、性能评估和风险分析;3、编写 RTL 代码,确保设计的功能正确性和稳定性;4、与系统设计团队紧密合作,确保 IP 核与 SoC 的兼容性和集成性;5、参与 IP 核的验证和调试工作,协助制定验证计划,解决开发及客户使用过程中的技术问题;6、编写并维护设计文档、用户指南等技术文档;7、跟踪相关领域的最新发展,不断提升 IP 核的竞争力。任职要求1、本科及以上学历,电子工程、计算机科学、微电子等相关专业;2、3 年及以上数字 IC 设计经验,有安全类、接口类或多媒体类 IP 设计经验者优先;3、具备良好的编程能力,熟练掌握 Verilog/VHDL 语言,熟悉数字电路设计和仿真验证流程;4、熟练使用常用 EDA 工具,如 Synopsys、Cadence 等,具备时序分析能力;5、具备良好的问题分析和解决能力,能够独立完成设计调试和问题排查;6、具备良好的沟通协调能力和团队合作精神,能够与跨部门团队紧密协作;7、对新技术有强烈的学习兴趣和自我驱动力,能够适应快速变化的工作环境。recruit@espressif.com
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射频 IC 设计工程师(星光计划)星光计划2025年07月01日「星光本科人才计划」是乐鑫科技专为全球顶尖本科毕业生打造的招聘项目,长期开放且独立于乐鑫校园招聘,是一条通向技术前沿、快速成长的高速通道。岗位职责1、创新设计:负责开发下一代射频电路,包括但不限于 VCO、LNA、PA、Mixer 等模块,从概念设计到产品验证,你将亲身参与并引领技术创新;2、高效仿真:进行复杂射频电路的高精度仿真和优化,推动电路性能达到行业领先水平;3、跨团队合作:与应用工程师、产品工程师和测试工程师紧密协作,参与跨学科项目,确保产品顺利量产并满足严格的性能要求;4、技术指导:指导并与版图工程师合作,优化版图设计,确保产品质量和性能的一致性;5、技术前沿探索:撰写和维护高质量的设计文档,进行前沿技术研究,推动公司技术能力不断提升。任职要求1、顶尖高校本科生,微电子/电子信息/通信工程等相关专业;2、掌握微波通信技术与射频电路理论知识,具备卓越的分析和解决问题能力;3、拥有一种或多种射频电路设计经验(如 VCO、LNA、PA、Mixer 等),具备创新思维和独立开发能力;4、熟悉 IC 设计和后端 Layout 设计流程,能够从设计到实现进行全面把控;5、优秀的沟通和学习能力,能够在高压环境中高效工作,乐于接受挑战并与团队紧密合作。campus@espressif.com
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CPU 设计工程师社会招聘2025年02月20日
岗位职责
1、设计、验证、优化 CPU 的微体系结构,实现指令集架构的功能和性能要求;
2、设计处理器的数据通路、控制逻辑和存储器层次结构;
3、研究和应用先进的技术,包括超标量、超线程、分支预测、乱序执行、多级缓存等,提高处理器的性能和效率;
4、与团队中的其他硬件和软件工程师、验证工程师紧密合作,确保 CPU 的功能和性能得到充分验证;
5、编写和维护 CPU 设计的规格说明、功能描述、微体系结构说明书等文档,支持硬件和软件开发团队;
6、多核及异构体系架构设计。
任职要求
1、本科或以上学历,计算机工程、电子工程、微电子工程等相关专业;
2、5 年以上 CPU 设计经验,熟悉处理器架构、微体系结构、数据通路、控制逻辑和存储器层次结构;
3、熟悉 C910 指令集和相关处理器架构,具有在此基础上设计处理器的经验优先考虑;
4、熟悉 Verilog 或 VHDL 等硬件描述语言,具有较强的逻辑设计能力和工程实现能力;
5、熟悉计算机体系结构和操作系统原理,了解处理器性能和效率的优化方法;
6、具备团队协作精神,良好的沟通和组织能力,以及良好的英语阅读和写作能力,能够阅读和编写技术文档和报告。
加分项
· 具有性能模拟和验证经验,熟悉计算机体系结构和性能分析工具;
· 具有 RISC-V 处理器架构的设计经验;
· 具有 CPU 微码设计和优化经验;
· 具有 CPU 电源管理和功耗优化经验;
· 具有 CPU 安全和加密技术的实现经验。
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数字 IC 设计工程师(星光计划)星光计划2025年07月01日「星光本科人才计划」是乐鑫科技专为全球顶尖本科毕业生打造的招聘项目,长期开放且独立于乐鑫校园招聘,是一条通向技术前沿、快速成长的高速通道。岗位职责1、负责 IP/SOC/低功耗等相关开发工作;2、根据设计需求,确定设计方案,并负责 RTL 实现;3、协助 EDA 仿真验证,部分参与 FPGA 验证;4、模块级时序约束、综合、STA 检查等相关工作;5、撰写文档,协助软件验证人员解决设计问题。任职要求1、顶尖高校本科生,微电子/电子信息/通信工程等相关专业;2、具备钻研能力,对数字设计有浓厚的兴趣和热爱;3、具有较强的学习能力和解决问题的能力,能够快速适应新技术和工具;4、掌握数字电路设计的基础知识,了解 Verilog 或 VHDL 语言。campus@espressif.com
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IC 验证工程师社会招聘2025年02月20日
岗位职责
1、根据设计相关文档制定验证计划,搭建验证环境,完成模块级到系统级的验证;
2、执行回归测试,提升验证的覆盖率;
3、配合芯片设计工程师查找修复设计缺陷;
4、指导设计部门实现可验证设计流程;
5、完成 RTL 级,门级和带 UPF 低功耗等验证工作;
6、协助 FPGA 工程师和软件工程师完成 FPGA 原型测试;
7、从多个维度保证芯片设计的完整性和正确性。
任职要求
1、本科及以上学历,计算机/电子工程/通信工程等相关专业,工作年限不限;
2、具有外设模块,通信模块或 SoC 系统等相关方向的设计或验证经验;
3、熟悉 Verilog,精通 C/SystemVerilog 等语言;
4、掌握 Python/Ruby/Perl/Shell/Tcl/Makefile 等一种或多种脚本;
5、熟悉 UVM 者优先;
6、熟悉数字芯片开发流程,有成功流片的项目经验者优先;
7、有 Formal 验证经验者优先。
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DFT 工程师社会招聘2025年02月20日
岗位职责
1、参与制定完整的 SoC 芯片和 Block level DFT 方案;
2、完成 DFT 电路设计/insertion,包括 Scan、Mbist、Bscan;
3、完成 DFT 模式的时序约束,协助完成 DFT 模式的时序收敛;
4、完成 DFT 电路的功能验证并解决各种相关的仿真问题;
5、设计并验证各种 high coverage 的 DFT 测试 pattern 和功能 pattern;
6、参与芯片 bring-up 调试以及 ATE bringup ;
7、参与芯片的良率提升以及故障分析。
任职要求
1、本科以上学历,3 年以上 DFT 工作经验;
2、熟悉 DFT 电路结构,包括 Scan、Mbist、Bscan;
3、熟练使用 DFT 设计工具,如有 Spyglass 经验者优先;
4、熟悉 Bottom Up DFT 流程,有相关经验者优先。
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数字中端设计工程师社会招聘2025年02月20日
岗位职责
1、模块和芯片的综合、形式验证、DFT;
2、CPF/UPF 编写及检查;
3、时序分析及综合优化;
4、功耗分析。
任职要求
1、本科及以上学历,微电子/电子工程/通信工程等相关专业;
2、工作年限不限,我们将根据求职者经验和能力提供高级或初级职位;
3、熟悉 Tcl 或者 Perl 等脚本语言,熟悉 Verilog;
4、熟悉 Design Flows 以及 EDA 工具软件;
5、熟悉 Sign-off 方法学以及 STA/Power 等方面的 EDA 工具软件的使用。
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数字 IC 后端工程师社会招聘2025年02月20日
岗位职责
1、Floorplan 布局规划、电源网络设计、CTS;
2、电压降分析,RC extraction 等;
3、Timing closure;
4、面积优化。
任职要求
1、本科及以上学历,微电子/电子工程/通信工程等相关专业;
2、3 年以上工作经验;
3、拥有 40 nm 及以下布局布线经验;
4、能够独立完成整个芯片 P&R 全流程及 IR_Drop, STA, Low Power 检查;
5、熟悉 Tcl 或者 Perl 等脚本语言;
6、熟悉 Design Flows 以及 EDA 工具软件;
7、熟悉 Sign-off 方法学以及 STA/Power 等方面的 EDA 工具软件的使用。
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FPGA 工程师社会招聘2025年02月20日
岗位职责
1、基于芯片设计需求,搭建和维护 FPGA 原型验证环境;
2、基于 FPGA 资源将 ASIC 设计移植为 FPGA 设计,完成 FPGA 的综合、仿真;
3、FPGA 时序和面积优化;
4、FPGA 版本的验证和发布;
5、参与系统级调试和验证,解决硬件相关问题;
6、分析和评估新技术和新工具,完善 FPGA 综合流程,持续提升 FPGA 设计效率和质量。
任职要求
1、本科以上学历,电子类相关专业;
2、3 年以上相关经验;
3、精通 Verilog HDL,熟悉数字电路设计;
4、熟悉 Xilinx / Altera FPGA,有相关开发和调试经验。
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IC 版图设计工程师社会招聘2025年02月20日岗位职责1、负责模拟/数模混合电路的版图设计、版图验证,tapeout;2、与电路设计工程师合作,优化版图确保电路性能最优化;3、完成 Sign-off 流程及检查,编写版图设计文档。任职要求1、微电子、电子类相关专业,本科及以上学历;2、3 年以上相关工作经验;3、熟练使用版图设计工具;4、会修改工艺文件;5、熟悉集成电路 CMOS 工艺流程,有 floorplan 经验;6、熟悉版图基本知识,对于寄生,噪声,器件,高精度匹配等知识有清晰了解;7、理解工艺的特征,包括:latch-up、ESD、器件匹配、shielding、seal ring、electromigration、metal fill 等;8、熟悉 Skill 脚本和 Pcell;9、熟悉至少一个脚本语言:Python、Perl、Ruby。加分项1、有 PA / LNA / PLL / ADC / DAC / VCO / TDC / phase interpolator / DCDC 等模块经验者优先考虑;2、有 RF 及物联网方面硬件开发设计经验者优先。个性特质1、具有良好的沟通能力、学习能力、分析能力和团队合作能力;2、良好的团队合作和服务意识、诚信正直;3、个性开朗、乐观、善于表达。recruit@espressif.com